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FRL模式，只有3 lanes 和4 lanes 工作模式， 3 lanes 工作模式下， 支持3 Gbps和6Gbps 两种速率；未使用的Lane3， source 和sink 都需要使用差分50Ω～150Ω端接；4 l、

HDMI2.1Source和Sink的LinkTrainingProcedureSource首先要读取Sink的EDID（EDID是I2C地址为0xA0/0xA1，长度为256字节的存储空间，包含Sink所支持的分辨率和比较高速率等信息），输出sink所支持的分辨率/速率。Source不能输出SinkEDID未支持的分辨率/速率。支持HDMI2.1的Sink，一定要在EDID的HF-VSDB对应字节把SCDC_Present设置为1，Max_FRL_Rate设置范围是1到6，数字0不支持FRL模式，其他值为保留值。在SCDC中把Sinkversion设置为1。anes 工作模式下， 支持6/8/10/12 Gbps 四种速率。 HDMI2.0标准和以前的设备兼容吗？信号完整性测试HDMI测试DDR测试

Max_FRL_Rate值具体含义如下，数字1支持3lanes模式下的3Gbps速率，其他速率和lane配置不支持；数字3支持3lanes模式下的3Gbps和6Gbps速率；4lanes模式下支持6Gbps速率，其他速率不支持。其他数字的含义类推。SCDC是I2C地址为0xA8/A9的存储空间，用于Source和Sink沟通交换状态和控制信息，部分字节Source和Sink都可以读写。与EDID不同，EDID对source是只读的。HDMI2.1Source和Sink沟通过程中，会使用到Sinkversion，UpdateFlags，SinkConfiguration，StatusFlags等信息。支持FRL模式的Source和Sink建立连接，需要进行LinkTraining，更新FRLrate也需要进行LinkTraining。信号完整性测试HDMI测试DDR测试克劳德实验室提供高速信号质量HDMI USB DDR一致性测试数据内容；

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HDMI物理层简介按照HDMI标准的定义，HDMI的设备分为Source设备(源设备)、Sink设备(接收设备)以及Cable(电缆)。Source设备用于产生HDMI信号输出，如DVD、机顶盒、数码相机、计算机、游戏机等；Sink设备用于接收HDMI信号并显示，如电视、投影、显示器等。除此以外，还有一种Repeater设备(中继设备),用于接收HDMI信号并重新分配输出，可以认为Repeater设备上同时有Sink设备的接口和Source设备的接口。图6.3是典型的HDMI的总线结构。

HDMI1.4b/2.0的测试难点：1)一些方案端接电压需要外接电源提供，或者端接电压不可调，无法验证极限情况；2)单端测试和差分测试信号采集需要更改硬件连接，过程繁琐耗时；3)测试信号速率随着分辨率变化，需要手动设置分辨率，测试无法自动化；这些问题在泰克HDMI2.1FRL测试方案中都得到了完美的解决。为了追求更好的视觉效果和体验，人们不满足于4Kp60Hz显示分辨率，也在追求8Kp60Hz和4Kp120Hz的体验。但是8Kp60Hz需要的带宽约64G（RGB/YCbCr4:4:4格式），远远超过了HDMI2.0的支持范围。所以HDMI协会增加HDMI2.1FRL（FixedRateLink）模式，实现接口带宽的增加，满足8Kp60Hz需要。同时需要结合相应的YCbCr4:2:0编码和视频压缩技术。HDMI输出端口功能测试；

源端测试的难点解决端接电压的实现泰克示波器和探棒，不需要外接电源，本身不仅可以提供标准的3.3V端接电压，用于协会要求的一致性测试。在用户自定义模式下，还提供可调的端接电压，例如设置3.0V的端接电压，用于验证源端芯片在端接电压变化时的情况。

单端和差分信号的自动采集对应单端项目和差分项目，测试时需要分别采集单端信号和差分信号；在HDMI1.4b/2.0测试中，都是通过差分探棒采集差分信号；手动更改探棒硬件连接后，采集单端信号。更改连接繁琐，无法自动化，造成了测试效率低。泰克Tri-mode探棒（三模探棒），在测试软件控制下，交替工作在单端模式（A-GND和B-GND），无需硬件连接的改变，可以实现8个单端信号的采集，再自动计算差分信号，从而实现了全部项目的自动化。除了三模探棒方案外，泰克还提供两台示波器级联自动化方案，通过8个channel实现对8个单端信号的同时采集，测试效率更高。 HDMI信号和协议测试？信号完整性测试HDMI测试DDR测试

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单端测试 这些测试使用单端探头在每个信号对内部进行。 a. 对内偏移 对内偏移测试具有重要意义，虽然信号是差分信号，但 是可以揭示了差分信号对内实际存在的不良部分。将测 试差分对内部的偏移，标准规定的极限为位时间的15% (TBIT)。与信号对间偏移一样，在执行这一测试前执行示 波器通道偏移校正非常重要。这可以保证比较大限度地降 低由于探测和采集系统偏移导致的误差。 b. 低电平输出电压 (VL) 执行VL测试的目的是保证信号电压电平落在规定的极限 范围内。这一测试对每个 TMDS 信号对的 DC 电压电平 进行检查。CTS规定低电平电压应落在2.7 V和2.9 V范 围内。 为保证满足标准，需要分析大量的波形。标准规定比较低 10,000 个波形。FastAcq 有助于更快地执行这一测试。 为确定电压电平，可以采用直方图方法。直方图的统计 比较大值(直方图峰值)表示为VL，并与标准极限进行比较。 信号完整性测试HDMI测试DDR测试

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