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来源: 发布时间:2023年03月11日

对于真实的数据信号来说,其频谱会更加复杂一些。比如伪随机序列(PRBS)码流的频谱的包络类似一个sinc函数。图1.4是用同一个发送芯片分别产生的800Mbps和2.5Gbps的PRBS信号的频谱,可以看到虽然输出数据速率不一样,但是信号的主要频谱能量集中在4GHz以内,也并不见得2.5Gbps信号的高频能量就比800Mbps的高很多。

频谱仪是对信号能量的频率分布进行分析的准确的工具,数字工程师可以借助频谱分析仪对被测数字信号的频谱分布进行分析。当没有频谱仪可用时,我们通常根据数字信号的上升时间估算被测信号的频谱能量:

信号的比较高频率成分=0.5/信号上升时间(10%~90%)

或者当使用20%~80%的上升时间标准时,计算公式如下:

信号的比较高频率成分=0.4/信号上升时间(20%~80%) 对于一个数字信号,要进行可靠的0、1信号传输,就必须满足一定的电平、幅度、时序等标准的要求。甘肃数字信号测试服务热线

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对于典型的3.3V的低电压TTL(LVTTL)信号来说,判决阈值的下限是0.8V,判决阈 值的上限是2.0V。正是由于判决阈值的存在,使得数字信号相对于模拟信号来说有更高的 可靠性和抗噪声的能力。比如对于3.3V的LVTTL信号来说,当信号输出电压为0V时, 只要噪声或者干扰的幅度不超过0.8V,就不会把逻辑状态由0误判为1;同样,当信号输出  电压为3.3V时,只要噪声或者干扰的幅度不会使信号电压低于2.0V,就不会把逻辑状态  由1误判为0。

从上面的例子可以看到,数字信号抗噪声和干扰的能力是比较强的。但也需要注意,这 个“强”是相对的,如果噪声或干扰的影响使得信号的电压超出了其正常逻辑的判决区间,数字信号也仍然有可能产生错误的数据传输。在许多场合,我们对数字信号质量进行分析和 测试的基本目的就是要保证其信号电平在进行采样时满足基本的逻辑判决条件。 福建数字信号测试厂家现货数字信号是指用一组特殊的状态来描述信号;

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数字信号并行总线与串行总线(Parallel and Serial Bus)

虽然随着技术的发展,现代的数字芯片已经集成了越来越多的功能,但是对于稍微复杂  一点的系统来说,很多时候单独一个芯片很难完成所有的工作,这就需要和其他芯片配合起  来工作。比如现在的CPU的处理能力越来越强,很多CPU内部甚至集成了显示处理的功  能,但是仍然需要配合外部的内存芯片来存储临时的数据,需要配合桥接芯片扩展硬盘、 USB等接口;现代的FPGA内部也可以集成CPU、DSP、RAM、高速收发器等,但有些  场合可能还需要配合用的DSP来进一步提高浮点处理效率,配合额外的内存芯片来扩展  存储空间,配合用的物理层芯片来扩展网口、USB等,或者需要多片FPGA互连来提高处  理能力。所有这一切,都需要用到相应的总线来实现多个数字芯片间的互连。如果我们把  各个功能芯片想象成人体的各个功能,总线就是血脉和经络,通过这些路径,各个功能  模块间才能进行有效的数据交换和协同工作。

为了提高信号在高速率、长距离情况下传输的可靠性,大部分高速的数字串行总线都会采用差分信号进行信号传输。差分信号是用一对反相的差分线进行信号传输,发送端采用差分的发送器,接收端相应采用差分的接收器。图1.13是一个差分线的传输模型及真实的差分PCB走线。

采用差分传输方式后,由于差分线对中正负信号的走线是紧密耦合在一起的,所以外界噪声对于两根信号线的影响是一样的。而在接收端,由于其接收器是把正负信号相减的结果作为逻辑判决的依据,因此即使信号线上有严重的共模噪声或者地电平的波动,对于的逻辑电平判决影响很小。相对于单端传输方式,差分传输方式的抗干扰、抗共模噪声能力 提高。 数字信号抖动的成因(Root Cause of Jitter);

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我们经常使用到的总线根据数据传输方式的不同,可以分为并行总线和串行总线。

并行总线是数字电路中早也是普遍采用的总线结构。在这种总线上,数据线、地址线、控制线等都是并行传输,比如要传输8位的数据宽度,就需要8根数据信号线同时传输;如果要传输32位的数据宽度,就需要32根数据信号线同时传输。除了数据线以外,如果要寻址比较大的地址空间,还需要很多根地址线的组合来不同的地址空间。图1.7是一个典型的微处理器的并行总线的工作时序,其中包含了1根时钟线、16根数据线、16根地址线以及一些读写控制信号。 什么是数字信号(DigitalSignal);福建数字信号测试厂家现货

数字信号上升时间是示波器中进行上升时间测量例子,光标交叉点指示出上升时间测量的起始点和结束点的位置;甘肃数字信号测试服务热线

反映的是一个5Gbps的信号经过35英寸的FR-4板材传输后的眼图,以及经过CTLE均衡后对眼图的改善。

FFE均衡的作用基本上类似于FIR(有限脉冲响应)滤波器,其方法是根据相邻比特的电压幅度的加权值进行当前比特幅度的修正,每个相邻比特的加权系数直接和通道的冲激响应有关。下面是一个三阶FFE的数学描述:

e(t)=cor(t-(0Tp))+cir(t-(1Tp))+czr(t-(2Tp))

式中,e(t)为时间t时的电压波形,是经校正(或均衡)后的电压波形;Tp为时间延迟(抽头的时间延迟);r(t-nTp)为距离当前时间n个抽头延迟之前的波形,是未经校正(或均衡)的波形;c,为校正系数(抽头系数)。 甘肃数字信号测试服务热线

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